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[未答复] simulink自带模块Variable Transport Delay模块生成代码时出错。

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发表于 2020-6-29 16:01:46 | 显示全部楼层 |阅读模式
在使用simulink中的PLL时,里面有一模块是Variable Transport Delay,在生成代码时提示“The "FixedStepDiscrete" solver cannot be used to simulate block diagram 'PLL_SIL2' because it contains continuous states”。这种情况下有谁知道该如何解决。谢谢!
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